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摘要:
电力线信道的噪声干扰很强,严重影响通信系统性能。文章提出了一种适于电力线通信中LDPC码的译码器硬件结构优化方法,并通过FPGA设计实现。算法的修正过程只包含简单的算术和逻辑运算,便于FPGA实现。本文方案提供的结构与常用的部分并行译码结构相比,节省了大量硬件资源。经软硬件仿真验证,硬件BP实现结构性能接近浮点BP算法,能应用于电力线通信等信噪比较低的传输领域。
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流水线式LDPC译码器的FPGA设计与仿真
LDPC
译码器
流水线
FPGA
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LDPC
译码器
流水线
FPGA
内容分析
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文献信息
篇名 电力线通信中LDPC译码器的优化设计与实现
来源期刊 电测与仪表 学科 工学
关键词 电力线信道 LDPC码 FPGA 并行译码结构 BP算法
年,卷(期) 2014,(20) 所属期刊栏目 产品及组件设计
研究方向 页码范围 105-108
页数 4页 分类号 TM73
字数 2402字 语种 中文
DOI
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 章坚武 杭州电子科技大学通信工程学院 155 1164 15.0 27.0
2 章谦骅 杭州电子科技大学通信工程学院 6 16 3.0 3.0
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研究主题发展历程
节点文献
电力线信道
LDPC码
FPGA
并行译码结构
BP算法
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
电测与仪表
半月刊
1001-1390
23-1202/TH
大16开
哈尔滨市松北区创新路2000号
14-43
1964
chi
出版文献量(篇)
7685
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22
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