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摘要:
随着ASIC、SoC和FPGA在工业生产和科研工作中的广泛应用,作为硬件描述语言的Verilog HDL已成为实现集成电路设计的重要方式,而设计师对其中赋值操作的错误使用,也导致了部分设计的不正确。因此,对于Verilog HDL中赋值操作的深入了解也成为解决设计中隐藏问题的瓶颈。基于层次化事件队列,对设计中经常遇到的赋值操作问题进行了深入剖析,并结合工作实际给出了避免设计中竞争问题出现的方法。
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文献信息
篇名 基于层次化事件队列的赋值操作应用
来源期刊 计算机系统应用 学科
关键词 Verilog HDL 竞争 层次化事件队列 编码规范
年,卷(期) 2014,(1) 所属期刊栏目
研究方向 页码范围 14-18,52
页数 6页 分类号
字数 3014字 语种 中文
DOI
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 孙健 3 4 1.0 2.0
2 张莎莎 4 11 1.0 3.0
3 时鹏飞 2 1 1.0 1.0
4 张雪 1 0 0.0 0.0
传播情况
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引文网络
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2014(0)
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研究主题发展历程
节点文献
Verilog HDL
竞争
层次化事件队列
编码规范
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
计算机系统应用
月刊
1003-3254
11-2854/TP
大16开
北京中关村南四街4号
82-558
1991
chi
出版文献量(篇)
10349
总下载数(次)
20
总被引数(次)
57078
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