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摘要:
针对无线通信中低功耗维特比译码器设计结构复杂的问题,提出一种四级流水串并结合的(2,1,9)低功耗维特比译码器。该译码器采用改进的加-比-选( ACS)单元,以降低硬件复杂度,在提高时钟运行速率的基础上减少运行功耗。幸存路径存储单元采用改进的路径相消方法,减少译码器的输出延迟,提高译码效率。性能分析结果表明,基于TSMC 0.18μm CMOS逻辑工艺,在1.62 V,125℃操作环境下,该译码器数据最大速度为50 MHz,自动布局布线后的译码器芯片面积约为0.212 mm2,功耗约为23.9 mW。
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内容分析
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文献信息
篇名 无线通信中的低功耗维特比译码器设计
来源期刊 计算机工程 学科 工学
关键词 维特比译码器 低功耗 加-比-选 路径度量存储 路径相消 幸存路径
年,卷(期) 2014,(10) 所属期刊栏目 ?移动互联与通信技术?
研究方向 页码范围 114-117
页数 4页 分类号 TH166
字数 2230字 语种 中文
DOI 10.3969/j.issn.1000-3428.2014.10.022
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 杨红官 湖南大学物理与微电子科学学院 28 95 6.0 7.0
2 乔树山 中国科学院微电子研究所 53 272 9.0 14.0
3 樊晓华 中国科学院微电子研究所 12 22 3.0 3.0
4 朱坤顺 湖南大学物理与微电子科学学院 2 8 2.0 2.0
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研究主题发展历程
节点文献
维特比译码器
低功耗
加-比-选
路径度量存储
路径相消
幸存路径
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
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计算机工程
月刊
1000-3428
31-1289/TP
大16开
上海市桂林路418号
4-310
1975
chi
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