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摘要:
介绍一种基于FPGA的数字磁通计的设计,利用FPGA控制同步采样ADC以固定频率进行采样,在FPGA内部实现了数字滤波、自动校准、自动量程选择、数字积分等功能.相比于模拟磁通计,简化了仪器的操作难度,提高了系统的稳定性.实验表明,其测量值无漂移,测量精度高于0.5%.
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基于FPGA芯片的数字频率计设计
数字频率计
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EDA
VHDL
基于FPGA的数字频率计的设计和实现
数字频率计设计
VHDL
现场可编程门阵列(FPGA)
直接测频法
内容分析
关键词云
关键词热度
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文献信息
篇名 基于FPGA的数字磁通计设计
来源期刊 电测与仪表 学科 工学
关键词 FPGA 数字磁通计 数字积分算法 NIOS-Ⅱ
年,卷(期) 2015,(3) 所属期刊栏目 产品及组件设计
研究方向 页码范围 107-111
页数 5页 分类号 TM933
字数 2710字 语种 中文
DOI
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 朱玉玉 西南科技大学信息工程学院 33 142 7.0 10.0
2 罗卫军 西南科技大学信息工程学院 5 18 2.0 4.0
3 勾承君 1 2 1.0 1.0
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研究主题发展历程
节点文献
FPGA
数字磁通计
数字积分算法
NIOS-Ⅱ
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
电测与仪表
半月刊
1001-1390
23-1202/TH
大16开
哈尔滨市松北区创新路2000号
14-43
1964
chi
出版文献量(篇)
7685
总下载数(次)
22
总被引数(次)
55393
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