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摘要:
为了消除图像编码过程中出现的空间冗余,H.264编码器采用了帧内预测技术提高压缩率.而在解码过程中,帧内预测解码部分占用了较多的时钟资源和硬件资源.本文针对协议中帧内预测编码的算法,通过分析,对算法进行化简,并根据邻块的空间相关性特点,设计了一种并行结构.经过功能验证与FPGA验证,表明该解码模块在消耗硬件资源增加17%的基础上,可以比常规解码模块提高45%的解码速度,较好的满足性能要求.
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文献信息
篇名 H.264解码器中帧内预测模块的硬件设计
来源期刊 网络新媒体技术 学科
关键词 H.264解码器 帧内预测 硬件实现
年,卷(期) 2016,(2) 所属期刊栏目 数字媒体技术
研究方向 页码范围 30-35
页数 6页 分类号
字数 3697字 语种 中文
DOI
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 罗家融 东华大学理学院 36 352 9.0 17.0
2 代路伟 东华大学理学院 3 18 2.0 3.0
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研究主题发展历程
节点文献
H.264解码器
帧内预测
硬件实现
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
网络新媒体技术
双月刊
2095-347X
10-1055/TP
大16开
北京海淀区北四环西路21号
2-304
1980
chi
出版文献量(篇)
3082
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5
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