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摘要:
随着国产化航空管制雷达的推进,设计了一种高可靠性的通用点迹处理硬件平台,其具有多种形式的高速接口和强大的处理能力,为航迹和点迹交互、雷达点迹处理的双套冗硬件提供了一种可能.该平台以DSP+ FPGA为主要处理器件,可同时处理4个通道雷达点迹数据,在接口上以标准CPCI总线和6对传输速率可达5 Gbit·s-1的高速通道为主要通信接口,可满足多通道间的数据交换.以某种类型的双套冗余雷达为例,点迹处理算法在该平台上的工程实现表明,算法对于点迹处理和点航迹交互以及帧间点迹滤波在工程实现上具有较好的应用价值.
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文献信息
篇名 双套冗余雷达点迹处理硬件设计与算法实现
来源期刊 电子科技 学科 工学
关键词 FPGA+ DSP 硬件架构 点迹处理 工程实现
年,卷(期) 2016,(2) 所属期刊栏目 电子·电路
研究方向 页码范围 145-147
页数 3页 分类号 TN957.51
字数 2006字 语种 中文
DOI 10.16180/j.cnki.issn1007-7820.2016.02.039
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 万卫华 中国电子科技集团第38研究所信号处理部 7 4 1.0 1.0
2 颜波涛 中国电子科技集团第38研究所信号处理部 9 19 2.0 3.0
传播情况
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引文网络
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研究主题发展历程
节点文献
FPGA+ DSP
硬件架构
点迹处理
工程实现
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
电子科技
月刊
1007-7820
61-1291/TN
大16开
西安电子科技大学
1987
chi
出版文献量(篇)
9344
总下载数(次)
32
总被引数(次)
31437
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