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摘要:
设计了一种新型变速箱电路,变速箱两边采用同一时钟,不需要额外的时钟输入,使用计数器来控制位宽转变的整个过程,并产生标志位来控制变速箱数据的输入和输出.在不改变数据传输波特率的情况下,解决在传输过程中数据的重复或丢失问题,实现两边不同数据位宽的正确转换.电路适用于在FPGA系统中,模块之间或者各IP之间的数据位宽不匹配的情况下调整模块之间的数据位宽,从而实现各内部模块之间的数据位宽匹配.仿真结果表明,以66位数据转64位数据为例,在不影响有效数据传输速率的情况下,可以在32个时钟周期内完成数据的无损转换.
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内容分析
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文献信息
篇名 一种适用于FPGA系统中的变速箱电路设计
来源期刊 电子与封装 学科 工学
关键词 变速箱 标志位控制 高速串行通信 Serdes FPGA系统
年,卷(期) 2016,(10) 所属期刊栏目 电路设计
研究方向 页码范围 19-22,26
页数 5页 分类号 TN402
字数 2419字 语种 中文
DOI
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 罗旸 4 19 2.0 4.0
2 何光旭 3 5 2.0 2.0
3 雷淑岚 4 4 1.0 1.0
传播情况
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引文网络
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研究主题发展历程
节点文献
变速箱
标志位控制
高速串行通信
Serdes
FPGA系统
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
电子与封装
月刊
1681-1070
32-1709/TN
大16开
江苏无锡市惠河路5号(208信箱)
2002
chi
出版文献量(篇)
3006
总下载数(次)
24
总被引数(次)
9543
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