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摘要:
随机译码算法因实现电路简单,被广泛应用于LDPC码全并行译码架构.介绍几种随机译码架构,简化基于MTFM(Majority-based Tracking Forecast Memories)的随机译码架构,将MTFM架构中的加法器改为简单的与门电路,进一步降低了资源消耗.同时,针对CCSDS标准(8176,7154)LDPC码进行性能仿真分析,表明基于MTFM的随机译码算法与最小和译码算法相比,只有0.2 dB的损失.此外,对改进前后的MTFM架构进行资源消耗比较,结果显示每个变量节点改进后比改进前资源相比少了一个slice,且当码长很长时,改进方案的资源消耗大幅降低.
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文献信息
篇名 基于随机译码算法的全并行架构
来源期刊 通信技术 学科 工学
关键词 随机译码 全并行 简化MTFM LDPC
年,卷(期) 2016,(7) 所属期刊栏目 信息处理与传输
研究方向 页码范围 821-825
页数 5页 分类号 TN911.22
字数 3216字 语种 中文
DOI 10.3969/j.issn.1002-0802.2016.07.005
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 吕晶 10 22 3.0 4.0
2 云飞龙 4 9 2.0 3.0
3 朱宏鹏 4 9 2.0 3.0
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研究主题发展历程
节点文献
随机译码
全并行
简化MTFM
LDPC
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
通信技术
月刊
1002-0802
51-1167/TN
大16开
四川省成都高新区永丰立交桥(南)创业路8号
62-153
1967
chi
出版文献量(篇)
10805
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