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摘要:
设计了一种集成在DC-DC芯片中的电荷泵锁相环.其中鉴频鉴相器(PFD)在传统的D触发器结构的基础上增加了复位延迟电路的延迟时间,减小了鉴相“死区”;电荷泵采用充放电电流对称的源极开关结构,解决了电流失配和电荷注入作用的影响;另外,设计了一种可编程的由D触发器构成的分频器电路.基于CMOS工艺,采用Cadence仿真软件对其进行仿真,结果表明该电荷泵锁相环在锁定时间、频率范围、相位抖动等方面均达到了指定的性能需求,且工作特性较好.其性能指标是:电源电压2.4V,频率调节范围250~750 kHz,锁定时间<50 μs,相位抖动<30 ns.
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文献信息
篇名 一种集成在DC-DC芯片中的电荷泵锁相环设计
来源期刊 电子科技 学科 工学
关键词 DC-DC PLL PFD 电荷泵 可编程分频器
年,卷(期) 2016,(8) 所属期刊栏目 电子·电路
研究方向 页码范围 25-27,144
页数 4页 分类号 TN86
字数 1993字 语种 中文
DOI 10.16180/j.cnki.issn1007-7820.2016.08.008
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节点文献
DC-DC
PLL
PFD
电荷泵
可编程分频器
研究起点
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引文网络交叉学科
相关学者/机构
期刊影响力
电子科技
月刊
1007-7820
61-1291/TN
大16开
西安电子科技大学
1987
chi
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