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原文服务方: 现代电子技术       
摘要:
针对信息安全问题的日益突出,提出了基于5/3整数小波的数字水印算法,给出了两种5/3小波的硬件架构:一种是基于RAM的流水线架构;另一种是基于行分组的行列并行架构。进而设计了基于FPGA的数字水印提取硬件系统,结果证明该算法具有很好的不可见性及鲁棒性,且复杂度低,硬件较容易实现,并将水印提取代码下载到FPGA硬件进行验证,结果证明该算法可以很好地实现水印的提取工作。
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文献信息
篇名 基于FPGA的数字水印提取系统设计研究
来源期刊 现代电子技术 学科
关键词 数字水印 5/3小波 FPGA 水印提取
年,卷(期) 2016,(15) 所属期刊栏目 通信与信息技术
研究方向 页码范围 62-66
页数 5页 分类号 TN915.08-34|TP37
字数 语种 中文
DOI 10.16652/j.issn.1004-373x.2016.15.016
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FPGA
水印提取
研究起点
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引文网络交叉学科
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期刊影响力
现代电子技术
半月刊
1004-373X
61-1224/TN
大16开
1977-01-01
chi
出版文献量(篇)
23937
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