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摘要:
基于65 nm CMOS工艺,设计了一种新型的CMOS主从式采样/保持电路.采用全差分开环主从式的双通道采样结构,提高了电路的线性度.采用负电压产生技术,解决了纳米级工艺下电源电压低的问题.采用Cadence Spectre软件对电路进行仿真分析.仿真结果显示,在1.9V电源电压、相干采样下,当输入频率为1.247 5 GHz,峰-峰值为0.4V的正弦波信号,采样率为2.5 GS/s,负载为0.8 pF时,电路的无杂散动态范围(SFDR)为78.31 dB,总谐波失真(THD)为-75.69 dB,有效位为11.51位,可用于超高速A/D转换器中.
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内容分析
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文献信息
篇名 一种CMOS超高速主从式采样/保持电路
来源期刊 微电子学 学科 工学
关键词 采样/保持电路 CMOS 主从式 超高速 A/D转换器
年,卷(期) 2017,(2) 所属期刊栏目 电路与系统设计
研究方向 页码范围 195-198
页数 4页 分类号 TN432
字数 语种 中文
DOI
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 王永禄 20 87 6.0 8.0
2 陈繁 2 4 1.0 2.0
6 胡云斌 7 19 3.0 3.0
10 陈振中 3 12 2.0 3.0
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研究主题发展历程
节点文献
采样/保持电路
CMOS
主从式
超高速
A/D转换器
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
微电子学
双月刊
1004-3365
50-1090/TN
大16开
重庆市南坪花园路14号24所
1971
chi
出版文献量(篇)
3955
总下载数(次)
20
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