一种结合高精度TDC的快速全数字锁相环

• 作者: 刘建 姚亚峰 孙金傲 霍兴华
• 来源期刊: 湖南大学学报（自然科学版）
• 关键词: 全数字锁相环 时间数字转换器 相调电路 可编程逻辑门阵列
• 年，卷（期）: 2017,（8）
• 所属期刊栏目: 电气工程
• 页码范围: 131-136
• 页数: 6页
• 分类号: TN492
• 语种: 中文
• DOI: 10.16339/j.cnki.hdxbzkb.2017.08.020

摘要

针对传统全数字锁相环锁相周期长、时间数字转换电路量化误差较大等问题,提出了一种在高分辨率时间数字转换器的基础上能够快速锁相的全数字锁相环.本设计提出的相调模块将量化的相位差还原成时间序列,并在状态机的控制下加入到重构信号中,从而能够在检测到相位差之后的最多两个输入参考时钟周期内使相位一次性对齐,锁相时间控制在0.72 μs之内;设计的上升沿检测电路能够在重构与参考信号同频时,准确地检测两者上升沿是否同时到来并给出相应的使能信号,从而在锁相时关闭时间数字转换电路,大大降低了电路的功耗;优化了多时钟多相位的时间数字转换器粗量化的计算方法,提高了粗量化速度,增大了计数器位宽,扩大了测量范围,并且量化误差控制在0.25 ns之内.最后完成了整体设计的RTL级建模及仿真,结果证明,该全数字锁相环具有锁相速度快、量化精度高、稳定性好、功耗低、输出频率便于调整等特点.