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摘要:
为了适应现代FPGA中的可编程逻辑单元日益复杂化的结构,已有的CAD工具中的打包阶段的处理过程预留了很大的灵活性,然而这引起了打包阶段运行时间的显著增长.本文提出一种考虑可编程逻辑单元中共享线网的打包方法S-AAPack.该方法先记录可编程逻辑单元中与当前打包处理相关的共享线网的信息,然后利用该记录的共享线网信息快速判断出不合法的映射,达到减少整体运行时间的目的.实验结果表明,与最新的VTR7.0相比,S-AAPack使打包阶段在运行时间方面实现了1.83倍的加速,同时不改变其输出结果在时序、面积等方面的质量.
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文献信息
篇名 一种基于CLB内部共享线网的高效的通用打包方法
来源期刊 复旦学报(自然科学版) 学科 工学
关键词 现场可编程逻辑门阵列 打包 运行时间优化 共享线网
年,卷(期) 2018,(1) 所属期刊栏目
研究方向 页码范围 100-106
页数 7页 分类号 TN403
字数 语种 中文
DOI
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 来金梅 复旦大学专用集成电路与系统国家重点实验室 68 322 9.0 13.0
2 杨钊 复旦大学专用集成电路与系统国家重点实验室 4 7 2.0 2.0
3 杨萌 复旦大学专用集成电路与系统国家重点实验室 7 26 4.0 4.0
传播情况
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引文网络
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研究主题发展历程
节点文献
现场可编程逻辑门阵列
打包
运行时间优化
共享线网
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
复旦学报(自然科学版)
双月刊
0427-7104
31-1330/N
16开
上海市邯郸路220号
4-193
1955
chi
出版文献量(篇)
2978
总下载数(次)
5
总被引数(次)
22578
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