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摘要:
提出了一种宽带低相噪频率合成器的设计方法.采用了数字锁相技术,该锁相技术主要由锁相环(phase locked loop,PLL)芯片、有源环路滤波器、宽带压控振荡器和外置宽带分频器等构成,实现了10~20 GHz范围内任意频率输出,具有输出频率宽、相位噪声低、集成度高、功耗低和成本低等优点.最后对该PLL电路杂散抑制和相位噪声的指标进行了测试,测试结果表明该PLL输出10 GHz时相位噪声优于—109 dBc/Hz@1 kHz,该指标与直接式频率合成器实现的指标相当.
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文献信息
篇名 一种宽带低相噪频率合成器的设计方法研究
来源期刊 电波科学学报 学科 工学
关键词 10~20 GHz 宽带 低相位噪声 锁相环 频率合成器
年,卷(期) 2018,(6) 所属期刊栏目 论文
研究方向 页码范围 746-751
页数 6页 分类号 TN74+2
字数 3024字 语种 中文
DOI 10.13443/j.cjors.2018010701
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研究主题发展历程
节点文献
10~20 GHz
宽带
低相位噪声
锁相环
频率合成器
研究起点
研究来源
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引文网络交叉学科
相关学者/机构
期刊影响力
电波科学学报
双月刊
1005-0388
41-1185/TN
大16开
河南市新乡138信箱3分箱
36-260
1986
chi
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