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摘要:
时钟信号是数字电路能够正常工作的基础,决定着数据能否正常判决.但是随着集成电路工艺的发展,时钟信号的边沿变化速率都变得非常快,快速的边沿速率会导致严重的信号完整性和电磁兼容性问题,为了确保时钟信号的完整性,时钟信号需要进行匹配设计.信号完整性分析中常用的几种匹配方法是否都适合于时钟信号,各种匹配方法的取值如何确定就成为了设计难点.为了能够获取高质量的时钟信号,文章结合仿真分析的方法,设计出典型时钟电路RC匹配电路,指导实际应用.
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文献信息
篇名 高速时钟信号的RC匹配电路设计与分析
来源期刊 信息通信 学科 工学
关键词 时钟信号 匹配电路 信号完整性
年,卷(期) 2018,(2) 所属期刊栏目 技术创新
研究方向 页码范围 45-47
页数 3页 分类号 TN79
字数 2593字 语种 中文
DOI
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 韩嫚莉 12 18 2.0 4.0
2 刘婷婷 2 0 0.0 0.0
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研究主题发展历程
节点文献
时钟信号
匹配电路
信号完整性
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
信息通信
月刊
1673-1131
42-1739/TN
大16开
湖北省武汉市
1987
chi
出版文献量(篇)
18968
总下载数(次)
92
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