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摘要:
为了解决传统轨道交通试验台控制器无法定制化、知识产权不易保护、接口单一、无法同步采样和智能运维等缺点,文章设计了一种基于ZYNQ(ARM+FPGA)作为主处理器,CPLD和MCU作为从处理器的轨道交通试验台通用控制器系统方案.其中ARM处理器用于以太网通信、无线通信、大数据存储、控制逻辑和控制算法的实现,同时通过内部AXI总线接口与FPGA快速通信.FPGA主要通过自主开发的高速串行通信方式(SSB总线)和从处理器CPLD通信,CPLD通过控制多片AD7606从而完成高速并行数据采集的要求.ARM还通过CAN通信接口与MCU通信,实现低速多种接口采集的扩展和控制.在控制器的实际应用中表明:该控制器能够作为平台灵活配置为轨道交通各核心控制系统的测试控制器,完成各核心控制系统所需要的各项功能、性能和算法的验证,产品性能可靠.
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文献信息
篇名 轨道交通试验台通用控制器的设计与实现
来源期刊 汽车实用技术 学科
关键词 轨道交通试验台 控制器 灵活配置 性能可靠
年,卷(期) 2021,(16) 所属期刊栏目 设计研究|Design and Research
研究方向 页码范围 43-47
页数 5页 分类号 U467.5
字数 语种 中文
DOI 10.16638/j.cnki.1671-7988.2021.016.013
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研究主题发展历程
节点文献
轨道交通试验台
控制器
灵活配置
性能可靠
研究起点
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引文网络交叉学科
相关学者/机构
期刊影响力
汽车实用技术
半月刊
1671-7988
61-1394/TH
大16开
西安市未央区凤城七路赛高广场1008室
1976
chi
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