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摘要:
详细介绍了如何在FPGA中利用VHDL语言实现超前滞后型数字锁相环,以便从位流数据中恢复出位时钟;并指出了其结构参数对于环路性能的影响。
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文献信息
篇名 速度反馈信号的检测和处理
来源期刊 长岭技术 学科 工学
关键词 数字锁相环 位时钟 FPGA VHDL语言 超前滞后型数字鉴相器 速度反馈信号
年,卷(期) 2004,(2) 所属期刊栏目
研究方向 页码范围 36-43
页数 8页 分类号 TN911.7
字数 语种
DOI
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 马选谋 长岭电子科技公司计量仪器处 1 0 0.0 0.0
2 徐满红 长岭电子科技公司计量仪器处 1 0 0.0 0.0
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2004(0)
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研究主题发展历程
节点文献
数字锁相环
位时钟
FPGA
VHDL语言
超前滞后型数字鉴相器
速度反馈信号
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
长岭技术
季刊
陕西省宝鸡市43信箱34分箱
出版文献量(篇)
806
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