原文服务方: 计算机应用研究       
摘要:
研究JPEG 2000标准中系数位平面编码的硬件实现问题,提出一种适合ASIC实现的结构,在保证编码速度的前提下,最大限度减小了片内小波系数缓存量,解决了扫描过程中如何对系数状态字进行读写的问题,大大减少了系统访问系数状态字的频率.设计中幅度细通道和清理通道并行工作,使编码时间比传统非并行工作减少30%以上.在FPGA上对设计进行了仿真验证.
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上下文
一次性扫描编码
并行位平面编码
一种高效的JPEG2000位平面编码器设计
位平面编码
通道并行编码
最高有效位检测
列快速扫描
内容分析
关键词云
关键词热度
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文献信息
篇名 JPEG 2000系数位平面编码的FPGA设计
来源期刊 计算机应用研究 学科
关键词 JPEG 2000 优化截断的嵌入式分块编码 位平面 硬件描述语言 FPGA
年,卷(期) 2005,(10) 所属期刊栏目 图形图像
研究方向 页码范围 157-161
页数 5页 分类号 TP331.2|TP91.72
字数 语种 中文
DOI 10.3969/j.issn.1001-3695.2005.10.052
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研究主题发展历程
节点文献
JPEG 2000
优化截断的嵌入式分块编码
位平面
硬件描述语言
FPGA
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
计算机应用研究
月刊
1001-3695
51-1196/TP
大16开
1984-01-01
chi
出版文献量(篇)
21004
总下载数(次)
0
总被引数(次)
238385
论文1v1指导