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摘要:
在高速数字系统设计中,信号完整性(SI)问题以及互连延迟引起的时序问题致关重要.分析了嵌入式视频系统高速数字的信号完整性问题,使用串行端接和分支总线拓扑解决信号完整性问题,通过Protel DXP 2004进行SI仿真验证;并以DM642与SDRAM之间的时序为例,对信号时序进行分析.
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文献信息
篇名 嵌入式视频系统中高速信号完整性分析
来源期刊 电子器件 学科 工学
关键词 高速数字设计 信号完整性 时序分析 DXP 2004
年,卷(期) 2005,(4) 所属期刊栏目
研究方向 页码范围 886-889
页数 4页 分类号 TN941
字数 2348字 语种 中文
DOI 10.3969/j.issn.1005-9490.2005.04.050
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 邓中亮 北京邮电大学电子工程学院 165 1541 20.0 31.0
2 段大高 北京邮电大学电子工程学院 15 116 8.0 10.0
3 崔岩松 北京邮电大学电子工程学院 23 224 9.0 14.0
传播情况
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2016(1)
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研究主题发展历程
节点文献
高速数字设计
信号完整性
时序分析
DXP 2004
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
电子器件
双月刊
1005-9490
32-1416/TN
大16开
南京市四牌楼2号
1978
chi
出版文献量(篇)
5460
总下载数(次)
21
总被引数(次)
27643
论文1v1指导