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QoS中堆排序的脉动阵列结构在FPGA上的实现
QoS中堆排序的脉动阵列结构在FPGA上的实现
作者:
吴彦宏
陈相宁
基本信息来源于合作网站,原文需代理用户跳转至来源网站获取
脉动阵列
堆排序
QoS
FPGA
Verilog HDL语言
摘要:
提出了一种用于实现堆排序的串行输入输出的脉动阵列结构,在FPGA上实现了基于该阵列结构的具有QoS保证的核心交换模块.对FPGA中运算部件的微结构进行了分析.实验结果表明,与软件实现相比用FPGA实现堆排序算法能够极大地提高运行速率和优化时序,适用于优秀QoS机制的硬件现实.
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神经网络
脉动阵列结构
BP算法
FPGA
"堆排序"的教学设计
数据结构
堆排序
教学设计
内容分析
文献信息
引文网络
相关学者/机构
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期刊文献
内容分析
关键词云
关键词热度
相关文献总数
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(/年)
文献信息
篇名
QoS中堆排序的脉动阵列结构在FPGA上的实现
来源期刊
科学技术与工程
学科
工学
关键词
脉动阵列
堆排序
QoS
FPGA
Verilog HDL语言
年,卷(期)
2008,(19)
所属期刊栏目
论文
研究方向
页码范围
5434-5438
页数
5页
分类号
TP393.09
字数
2621字
语种
中文
DOI
10.3969/j.issn.1671-1815.2008.19.019
五维指标
作者信息
序号
姓名
单位
发文数
被引次数
H指数
G指数
1
陈相宁
南京大学电子科学与工程系
32
200
7.0
13.0
2
吴彦宏
南京大学电子科学与工程系
4
34
2.0
4.0
传播情况
被引次数趋势
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引文网络
引文网络
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研究主题发展历程
节点文献
脉动阵列
堆排序
QoS
FPGA
Verilog HDL语言
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
科学技术与工程
主办单位:
中国技术经济学会
出版周期:
旬刊
ISSN:
1671-1815
CN:
11-4688/T
开本:
大16开
出版地:
北京市海淀区学院南路86号
邮发代号:
2-734
创刊时间:
2001
语种:
chi
出版文献量(篇)
30642
总下载数(次)
83
总被引数(次)
113906
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