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Synphony HLS为ASIC和FPGA架构生成最优化RTL代码
Synphony HLS为ASIC和FPGA架构生成最优化RTL代码
作者:
丛秋波
基本信息来源于合作网站,原文需代理用户跳转至来源网站获取
ASIC
FPGA
Synphony HLS
摘要:
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文献信息
篇名
Synphony HLS为ASIC和FPGA架构生成最优化RTL代码
来源期刊
电子设计技术
学科
关键词
ASIC
FPGA
Synphony HLS
年,卷(期)
2009,(12)
所属期刊栏目
技术前沿
研究方向
页码范围
24
页数
1页
分类号
字数
998字
语种
中文
DOI
10.3969/j.issn.1023-7364.2009.12.009
五维指标
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FPGA
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研究起点
研究来源
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研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
电子设计技术
主办单位:
中国电子报社
出版周期:
月刊
ISSN:
1023-7364
CN:
11-3617/TN
开本:
16开
出版地:
北京市
邮发代号:
创刊时间:
1994
语种:
chi
出版文献量(篇)
5532
总下载数(次)
6
总被引数(次)
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