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摘要:
AES算法中字节替换和轮密钥扩展都需使用模逆运算.模逆运算是AES算法中最复杂的运算,也是AES算法中最关键的模块之一.本文分析二进制扩展的欧几里德算法,基于该算法使用Verilog HDL设计模逆运算电路,通过FPGA实现模逆运算.电路选用优先权编码器、比较器和移位寄存器等基本逻辑部件组成,使得两个多项式次数的计算、比较、相减和多项式系数的移位操作并行进行,加速模逆运算的过程.硬件实现模逆运算具有高效、快速的特点,时AES算法的硬件实现具有实际价值.
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文献信息
篇名 AES算法中模逆运算电路设计与实现
来源期刊 小型微型计算机系统 学科 工学
关键词 AES算法 模逆运算 二进制扩展的欧几里德算法 硬件设计
年,卷(期) 2011,(6) 所属期刊栏目 人工智能理论及其它
研究方向 页码范围 1240-1244
页数 分类号 TP309
字数 5463字 语种 中文
DOI
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 罗永龙 安徽师范大学数学计算机科学学院 70 482 13.0 18.0
2 齐学梅 安徽师范大学网络与信息安全工程技术研究中心 19 114 8.0 10.0
3 程桂花 安徽师范大学数学计算机科学学院 11 53 4.0 7.0
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AES算法
模逆运算
二进制扩展的欧几里德算法
硬件设计
研究起点
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期刊影响力
小型微型计算机系统
月刊
1000-1220
21-1106/TP
大16开
辽宁省沈阳市东陵区南屏东路16号
8-108
1980
chi
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