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基于DSP Builder数字滤波器的FPGA设计
基于DSP Builder数字滤波器的FPGA设计
作者:
雷能芳
基本信息来源于合作网站,原文需代理用户跳转至来源网站获取
FPGA
无限长脉冲响应滤波器
DSP Builder
QuartusⅡ
摘要:
现场可编程门阵列(FPGA)器件广泛应用于数字信号处理领域,而使用VHDL或VerilogHDL语言进行设计比较复杂.提出一种采用DSP Builder实现ⅡR数字滤波器的设计方案,按照Matlab/Simulink/DSP Builder/QuartusⅡ的设计流程,设计了一个4阶ⅡR低通数字滤波器,并通过QuartusⅡ软件中的嵌入式逻辑分析仪SignalTapⅡ对设计进行了硬件实时测试.结果表明,所设计的ⅡR数字滤波器功能正确,性能良好.
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Builder
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基于FPGA的数字滤波器的设计与实现
数字滤波器
现场可编程门阵列
DSP Builder
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基于FPGA的FIR滤波器设计
FPGA
FIR滤波器
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文献信息
篇名
基于DSP Builder数字滤波器的FPGA设计
来源期刊
价值工程
学科
工学
关键词
FPGA
无限长脉冲响应滤波器
DSP Builder
QuartusⅡ
年,卷(期)
2011,(7)
所属期刊栏目
信息技术
研究方向
页码范围
141-142
页数
分类号
TN911.72
字数
1185字
语种
中文
DOI
10.3969/j.issn.1006-4311.2011.07.100
五维指标
作者信息
序号
姓名
单位
发文数
被引次数
H指数
G指数
1
雷能芳
28
96
6.0
8.0
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引证文献(1)
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研究主题发展历程
节点文献
FPGA
无限长脉冲响应滤波器
DSP Builder
QuartusⅡ
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
价值工程
主办单位:
河北省技术经济管理现代化研究会
出版周期:
旬刊
ISSN:
1006-4311
CN:
13-1085/N
开本:
大16开
出版地:
河北省石家庄市槐安西路88号卓达物业楼A501室
邮发代号:
18-2
创刊时间:
1982
语种:
chi
出版文献量(篇)
66563
总下载数(次)
245
总被引数(次)
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