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摘要:
本文在分析和比较现有小数分频方法的基础上,提出了一种改进型的累加器小数分频法,以实现更高精度的小数分频.最后利用VHDL语言在ACTIVE-HDL仿真软件下进行了仿真,仿真结果显示:clk_out与clk1023频率基本一致;每个clk_out时钟周期有48或49个clk_in时钟,达到了分频的目的.
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文献信息
篇名 基于FPGA的一种改进型小数分频法
来源期刊 软件 学科 工学
关键词 FPGA 小数分频器 仿真
年,卷(期) 2012,(1) 所属期刊栏目 网络与通信安全
研究方向 页码范围 34-35,38
页数 分类号 TN772
字数 2607字 语种 中文
DOI 10.3969/j.issn.1003-6970.2012.01.008
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 陈宗义 中国矿业大学信电学院 3 7 2.0 2.0
2 马洪亮 中国矿业大学信电学院 2 4 1.0 2.0
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研究主题发展历程
节点文献
FPGA
小数分频器
仿真
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
软件
月刊
1003-6970
12-1151/TP
16开
北京市3108信箱
1979
chi
出版文献量(篇)
9374
总下载数(次)
40
总被引数(次)
23629
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