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S 波段低相噪捷变频频率综合器设计
S 波段低相噪捷变频频率综合器设计
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摘要：
介绍了一种S波段低相噪捷变频频率综合器设计方法.由于采用DDS+PLL的方式使此频率综合器相噪优于-115dBc/Hz@1kHz,跳频时间小于5us.
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期刊影响力
数字技术与应用
主办单位：
天津市电子仪表信息研究所
出版周期：
月刊
ISSN：
1007-9416
CN：
12-1369/TN
开本：
16开
出版地：
天津市
邮发代号：
6-251
创刊时间：
1983
语种：
chi
出版文献量（篇）
20434
总下载数（次）
106
总被引数（次）
35701
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