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摘要:
针对内存系统中高强度的容错编码容易造成过大开销的问题,为同时实现容错强度和容错开销的权衡,提出一种低开销的支持混合容错编码的动态调节设计.通过分析发现常见纠错检错编码数据位长与校验位长存在固定的比例关系,提出一种地址映射逻辑电路;当系统存取内存数据及容错强度发生调节时,该方法可保证容错编码中校验信息的存取,实现对内存容错强度调节以及数据与校验信息在内存中分开存储的支持.实验结果表明,文中设计简单,硬件和性能代价小、功耗开销低.
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文献信息
篇名 面向内存的混合容错编码动态调节设计
来源期刊 计算机辅助设计与图形学学报 学科 工学
关键词 内存系统 可靠性 容错设计 纠错检错编码
年,卷(期) 2014,(9) 所属期刊栏目 VLSI设计与测试及电子设计自动化
研究方向 页码范围 1479-1486
页数 8页 分类号 TP306+.2
字数 6171字 语种 中文
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研究主题发展历程
节点文献
内存系统
可靠性
容错设计
纠错检错编码
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
计算机辅助设计与图形学学报
月刊
1003-9775
11-2925/TP
大16开
北京2704信箱
82-456
1989
chi
出版文献量(篇)
6095
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15
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94943
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