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摘要:
为了实现简易电子钟的功能,以FPGA应用设计为基础,使用Verilog HDL语言编写并且使用Quartus Ⅱ进行仿真.本设计包含计时模块、译码显示模块,实现设计功能且验收效果良好.
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内容分析
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文献信息
篇名 基于FPGA的简易电子钟
来源期刊 电脑知识与技术 学科 工学
关键词 简易电子钟 Verilog FPGA
年,卷(期) 2019,(10) 所属期刊栏目 计算机工程应用技术
研究方向 页码范围 206-207
页数 2页 分类号 TP391
字数 832字 语种 中文
DOI
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 赵颖 大连理工大学城市学院 11 40 3.0 6.0
2 刘立波 大连理工大学城市学院 21 44 4.0 6.0
3 苏岩淇 大连理工大学城市学院 4 2 1.0 1.0
4 李永康 大连理工大学城市学院 4 2 1.0 1.0
5 薛玲月 大连理工大学城市学院 2 1 1.0 1.0
6 杨熠欣 大连理工大学城市学院 2 1 1.0 1.0
传播情况
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引文网络
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研究主题发展历程
节点文献
简易电子钟
Verilog
FPGA
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
电脑知识与技术
旬刊
1009-3044
34-1205/TP
大16开
安徽省合肥市
26-188
1994
chi
出版文献量(篇)
58241
总下载数(次)
228
总被引数(次)
132128
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