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摘要:
SM3算法是我国商用密码杂凑算法标准.为了提高SM3算法的吞吐量,减少运算资源占用,使其更好地应用于硬件加密场景,提高执行效率与速度,进行流水线结构设计,在其基础上对关键运算路径进行并行计算设计.同时采用进位保留加法器(CSA)进行关键路径的压缩,使完成一次压缩函数中关键路径计算所需的时钟周期明显减少.基于FPGA对方案进行实现,并与其他几种实现方案进行性能对比,结果表明该方案的吞吐量为80.43 Gbit/s,更易于在对吞吐量有较高需求的场景中使用.
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压缩函数
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文献信息
篇名 基于FPGA的SM3算法快速实现方案
来源期刊 计算机应用与软件 学科 工学
关键词 SM3 算法 FPGA Hash 函数 流水线结构 并行计算
年,卷(期) 2020,(6) 所属期刊栏目 算法
研究方向 页码范围 259-262
页数 4页 分类号 TP309.7
字数 2533字 语种 中文
DOI 10.3969/j.issn.1000-386x.2020.06.045
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 邓建球 28 30 3.0 4.0
2 丛林虎 35 109 6.0 9.0
3 方轶 13 9 2.0 2.0
4 陈泽宇 3 0 0.0 0.0
传播情况
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引文网络
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研究主题发展历程
节点文献
SM3
算法
FPGA
Hash
函数
流水线结构
并行计算
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
计算机应用与软件
月刊
1000-386X
31-1260/TP
大16开
上海市愚园路546号
4-379
1984
chi
出版文献量(篇)
16532
总下载数(次)
47
总被引数(次)
101489
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