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摘要:
通过对HDB3编译码原理的分析,提出了一种基于可编程逻辑器件EPM7064SLC44和模拟开关4052实现HDB3编译码的方法,给出了硬件设计电路图、软件设计流程和HDB3编译码器的仿真波形.此实现方法具有硬件设计简单、运行速度快、成本低等优点.同时由于CPLD可重复编程的特点,可以对它进行在线修改,便于设备的调试和运行.此编译码器已经过实际测试,运行稳定可靠,可用于实际电路中.
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文献信息
篇名 基于CPLD的HDB3编译码器
来源期刊 电子科技 学科 工学
关键词 HDB3码 CPLD Verilog语言
年,卷(期) 2005,(9) 所属期刊栏目 技术论文
研究方向 页码范围 37-40
页数 4页 分类号 TN762
字数 1748字 语种 中文
DOI 10.3969/j.issn.1007-7820.2005.09.010
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 王兰勋 河北大学电子信息工程学院 69 360 9.0 15.0
2 贾惠彬 河北大学电子信息工程学院 1 7 1.0 1.0
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研究主题发展历程
节点文献
HDB3码
CPLD
Verilog语言
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
电子科技
月刊
1007-7820
61-1291/TN
大16开
西安电子科技大学
1987
chi
出版文献量(篇)
9344
总下载数(次)
32
总被引数(次)
31437
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