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摘要:
中值滤波广泛用于图像处理领域,但用硬件实现时,占用资源过大.本文介绍了一种基于位级运算的中值滤波硬件实现,并给出了其电路结构.这种方法使得硬件资源和输入数据的位宽成线性关系.最后借助Altera公司的Cyclone系列FPGA芯片EP1C12和Quartus Ⅱ6.0开发软件对设计进行了仿真验证.
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文献信息
篇名 中值滤波的FPGA实现
来源期刊 首都师范大学学报(自然科学版) 学科 工学
关键词 中值滤波 位级运算 FPGA.
年,卷(期) 2007,(6) 所属期刊栏目
研究方向 页码范围 27-29
页数 3页 分类号 TP391
字数 659字 语种 中文
DOI 10.3969/j.issn.1004-9398.2007.06.007
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 李锦萍 首都师范大学信息工程学院 15 122 7.0 10.0
2 王竹 首都师范大学信息工程学院 7 49 5.0 7.0
3 栗加顺 首都师范大学物理系 5 32 4.0 5.0
4 吴少群 安徽理工学校机电电子教研室 2 9 1.0 2.0
传播情况
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研究主题发展历程
节点文献
中值滤波
位级运算
FPGA.
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
首都师范大学学报(自然科学版)
双月刊
1004-9398
11-3189/N
16开
北京西三环北路105号
2-293
1976
chi
出版文献量(篇)
2309
总下载数(次)
13
总被引数(次)
18820
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