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摘要:
分析了DVB-S2中LDPC码的特点,给出了一种面向FPGA的LDPC码编码实现方案,并采用Verilog HDL语言在Viaex 4 xe4vlx60芯片上实现了该编码器的设计,设计采用多个BlockRAM存储校验位,实现了与同一信息位关联的所有校验位的并行处理,提高了编码速度.综合结果表明:该编码器的吞吐量约为49.95 Mbit/s,在占用资源较少的情况下满足了DVB-S2标准的要求.
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文献信息
篇名 DVB-S2系统中LDPC编码的FPGA实现
来源期刊 重庆邮电大学学报(自然科学版) 学科 工学
关键词 DVB-S2 低密度奇偶校验码 FPGA
年,卷(期) 2008,(4) 所属期刊栏目 通信与电子
研究方向 页码范围 436-439
页数 分类号 TN911
字数 语种 中文
DOI
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 王琳 重庆邮电大学编码技术研究所 99 468 10.0 15.0
5 张文俊 重庆邮电大学编码技术研究所 4 12 2.0 3.0
传播情况
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引文网络
引文网络
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研究主题发展历程
节点文献
DVB-S2
低密度奇偶校验码
FPGA
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
重庆邮电大学学报(自然科学版)
双月刊
1673-825X
50-1181/N
大16开
重庆南岸区
78-77
1988
chi
出版文献量(篇)
3229
总下载数(次)
12
总被引数(次)
19476
相关基金
重庆市自然科学基金
英文译名:
官方网址:http://law.ddvip.com/law/2006-09/11584979384040.html
项目类型:重点项目
学科类型:
  • 期刊分类
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