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摘要:
根据2M误码测试仪的系统整体功能要求.给出了基于FPGA的2M误码测试仪的系统硬件架构和核心控制器FPGA内核的设计框架。重点介绍了系统硬件结构中E1接口的设计方法和软件中的系统时钟模块、测试序列发生模块、位同步信号提取模块和帧同步信号检测模块的FPGA设计方法。同时以Ahera的QuartusⅡ软件为开发平台,给出了部分模块的仿真波形图。
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S3C2410
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文献信息
篇名 基于FPGA的2M误码测试仪设计
来源期刊 电子元器件应用 学科 工学
关键词 2M误码测试仪 E1接口 FPGA内核设计 VHDL编程
年,卷(期) 2009,(8) 所属期刊栏目
研究方向 页码范围 52-57
页数 6页 分类号 TN911.22
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1 段颖妮 19 42 4.0 6.0
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研究主题发展历程
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E1接口
FPGA内核设计
VHDL编程
研究起点
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期刊影响力
电子元器件应用
月刊
1563-4795
大16开
西安市科技路37号海星城市广场B座240
1999
chi
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5842
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7
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11366
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