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基于FPGA的通用FFT处理器的设计
基于FPGA的通用FFT处理器的设计
作者:
张裕
方康玲
基本信息来源于合作网站,原文需代理用户跳转至来源网站获取
FPGA
FFT
基2
时域抽取
块浮点
摘要:
介绍了一种通用的可以在低端或是高端的FPGA上实现N(N=2M,M=2,3,4...)点FFT变换的方法.设计采用基4布斯编码算法和华莱士树算法设计完成了16X16位有符号数并行乘法器,并采用此并行乘法器为核心设计了FFT算法中的基-2蝶形运算单元,设计了串并转化模块、并串转换模块、移位选择模块、溢出检测模块和地址与控制模块等其它模块,并以这些模块和FPGA内部的双口RAM和ROM为基础组成了基-2FFT算法模块.整个模块采用基-2时域抽取,顺序输入,逆序输出的方法;利用Modelsim完成了FFT模块的前后仿真;利用Matlab编写了用于比较仿真结果和Matlab中FFT函数产生的结果的程序,从而验证了仿真结果的正确性.该模块最后能够在Cyclone EP1C6Q240C8型FPGA上稳定运行在60MHz.整个FFT模块能够在183μs左右完成1024点的16位定点复数FFT运算,能够满足一般工程的要求.该方法也可以用于实现更低点数或是更高点数的FFT运算.
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内容分析
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文献信息
篇名
基于FPGA的通用FFT处理器的设计
来源期刊
计算机技术与发展
学科
工学
关键词
FPGA
FFT
基2
时域抽取
块浮点
年,卷(期)
2010,(8)
所属期刊栏目
研究方向
页码范围
87-90,95
页数
分类号
TN402
字数
3521字
语种
中文
DOI
10.3969/j.issn.1673-629X.2010.08.023
五维指标
作者信息
序号
姓名
单位
发文数
被引次数
H指数
G指数
1
方康玲
武汉科技大学信息科学与工程学院
148
1157
17.0
26.0
2
张裕
武汉科技大学信息科学与工程学院
4
71
3.0
4.0
传播情况
被引次数趋势
(/次)
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引文网络
引文网络
二级参考文献
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共引文献
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引证文献
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研究主题发展历程
节点文献
FPGA
FFT
基2
时域抽取
块浮点
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
计算机技术与发展
主办单位:
陕西省计算机学会
出版周期:
月刊
ISSN:
1673-629X
CN:
61-1450/TP
开本:
大16开
出版地:
西安市雁塔路南段99号
邮发代号:
52-127
创刊时间:
1991
语种:
chi
出版文献量(篇)
12927
总下载数(次)
40
总被引数(次)
111596
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