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摘要:
高层次综合中的模块分配会直接影响到寄存器分配方案,进而影响到综合后电路的面积、时延、功耗和可测性.为此提出一种面向可测性的模块分配方案.在讨论了考虑可测性的模块分配原则之后,提出面向可测性的模块分配的权重图模型,并在此基础上给出基于权重图的可测性模块分配算法.按照最大可测性提高的原则,通过动态地修改权重对模块进行考虑可测性的均衡分配,并最终输出模块分配方案.对标准电路进行实验的结果表明,除了较小的面积开销外,采用文中方案的电路的可测性优于其他方案.
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文献信息
篇名 高层次综合中的可测性模块分配方案
来源期刊 计算机辅助设计与图形学学报 学科 工学
关键词 高层次综合 模块分配 可测性 权重图
年,卷(期) 2011,(3) 所属期刊栏目 VLSI设计与测试及电子设计自动化
研究方向 页码范围 503-507
页数 分类号 TN74
字数 3314字 语种 中文
DOI
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 杨士元 清华大学自动化系 124 1303 17.0 30.0
2 王红 清华大学自动化系 52 388 11.0 18.0
3 王崇斌 6 6 1.0 2.0
4 成本茂 10 41 3.0 6.0
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研究主题发展历程
节点文献
高层次综合
模块分配
可测性
权重图
研究起点
研究来源
研究分支
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引文网络交叉学科
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期刊影响力
计算机辅助设计与图形学学报
月刊
1003-9775
11-2925/TP
大16开
北京2704信箱
82-456
1989
chi
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