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摘要:
以计算机图形学为基础,文章设计了一种具有较好通用性的嵌入式图形处理器裁剪引擎.重点剖析了裁剪算法和裁剪引擎RTL级模型的设计,该模型采用Verilog HDL实现引擎的IP软核,并在QHartusⅡ环境中完成IP核的功能仿真与时序验证.综合后,IP核占用FPGA资源为9489逻辑单元,实现了对图形进行裁剪的任务,达到了预期的设计要求.
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文献信息
篇名 嵌入式图形处理器裁剪引擎的设计
来源期刊 计算机与数字工程 学科 工学
关键词 图形处理器 裁剪引擎 OpenGL
年,卷(期) 2011,(10) 所属期刊栏目 图像处理
研究方向 页码范围 161-165
页数 分类号 TP391.41
字数 3394字 语种 中文
DOI 10.3969/j.issn.1672-9722.2011.10.042
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 吴宁 南京航空航天大学电子信息工程学院 78 622 12.0 22.0
2 谭显强 南京航空航天大学电子信息工程学院 2 12 2.0 2.0
3 田兵 南京航空航天大学电子信息工程学院 1 3 1.0 1.0
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研究主题发展历程
节点文献
图形处理器
裁剪引擎
OpenGL
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
计算机与数字工程
月刊
1672-9722
42-1372/TP
大16开
武汉市东湖新技术开发区凤凰产业园藏龙北路1号
1973
chi
出版文献量(篇)
9945
总下载数(次)
28
总被引数(次)
47579
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