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摘要:
LDPC(low density parity check code)码是目前最优秀的码字之一,其接近香农传输极限的性能使其成为第四代通信系统(4G)强有力的竞争者.论文通过Verilog实现LDPC编译码算法从而提高运算效率,选用了“π旋转矩阵构造法”进行编码,“皇后算法”较好的避免了H矩阵中小环的出现.译码采用“UMP BP Based(最小和或最大积)算法”,其中的对数运算将小数控制在了100到100之间,对于运算过程中的大量小数均采用Q8(定点数)格式表示,范围 128≤X≤127.996 093 75,精度0.003 906 25,从而避免了浮点数运算,因此可以完全采用Verilog语言描述LDPC译码算法.程序中没有使用任何公司的IP核,适用于所有FPGA,可移植性好.
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FPGA
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文献信息
篇名 基于Verilog的LDPC编译码设计
来源期刊 重庆大学学报 学科 工学
关键词 LDPC Verilog实现 Q格式 π矩阵 UMP BP-Based算法
年,卷(期) 2014,(6) 所属期刊栏目
研究方向 页码范围 45-50
页数 分类号 TP309
字数 语种 中文
DOI 10.11835/j.issn.1000-582X.2014.06.007
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 何伟 重庆大学通信工程学院 88 1119 16.0 30.0
2 郭志欢 重庆大学通信工程学院 1 0 0.0 0.0
传播情况
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引文网络
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研究主题发展历程
节点文献
LDPC
Verilog实现
Q格式
π矩阵
UMP BP-Based算法
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
重庆大学学报
月刊
1000-582X
50-1044/N
大16开
重庆市沙坪坝正街174号
78-16
1960
chi
出版文献量(篇)
6349
总下载数(次)
8
总被引数(次)
85737
论文1v1指导