原文服务方: 微电子学与计算机       
摘要:
结合一款基于M IPS14K内核的SoC中A HB总线矩阵的设计需求,分析单层A HB总线的特性及不足,提出并实现了一种可配置、层次化、高效的A HB总线矩阵体系架构。该总线矩阵符合A HB lite协议标准,支持多路MASTER/SLAVE并行访问,减小了总线仲裁延迟,提高了系统带宽,应用高效的轮询仲裁机制,提高嵌入式SoC芯片的整体性能。本设计实现了5主5从的A HB总线矩阵,已应用于一款SM IC55 nm工艺条件下工作频率为160 M Hz的轻量级嵌入式网络处理器SoC芯片,完成FPGA系统级验证并实现了流片设计。
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文献信息
篇名 AHB Matrix 互连总线 IP的设计与实现
来源期刊 微电子学与计算机 学科
关键词 AHB AHB Matrix AHB-Lite 互连总线
年,卷(期) 2015,(10) 所属期刊栏目
研究方向 页码范围 54-57
页数 4页 分类号 TP492
字数 语种 中文
DOI
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 吴斌 中国科学院微电子研究所 161 2294 16.0 45.0
2 叶甜春 中国科学院微电子研究所 200 911 14.0 18.0
3 尉志伟 中国科学院微电子研究所 3 13 2.0 3.0
4 罗惠文 中国科学院微电子研究所 1 8 1.0 1.0
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研究主题发展历程
节点文献
AHB
AHB Matrix
AHB-Lite
互连总线
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
微电子学与计算机
月刊
1000-7180
61-1123/TN
大16开
1972-01-01
chi
出版文献量(篇)
9826
总下载数(次)
0
总被引数(次)
59060
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