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摘要:
随着高速数字信号的快速发展,对集成多核和高速接口的处理器的电源的上电时序的设计则越来越重要,严格的上电时序保证了器件免受损坏和进入良好的工作状态;基于CPLD的多电源上电时序的控制设计则更加可靠、稳定、精确.
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文献信息
篇名 基于CPLD的多电源上电时序的控制设计
来源期刊 电子世界 学科
关键词 电源 上电时序 CPLD
年,卷(期) 2016,(22) 所属期刊栏目 探索与观察
研究方向 页码范围 56-57
页数 2页 分类号
字数 958字 语种 中文
DOI
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 陈展 株洲中车时代电气股份有限公司通信信号事业部 2 3 1.0 1.0
2 马茗岗 株洲中车时代电气股份有限公司通信信号事业部 1 2 1.0 1.0
3 罗永升 株洲中车时代电气股份有限公司通信信号事业部 3 2 1.0 1.0
4 孙尚 株洲中车时代电气股份有限公司通信信号事业部 1 2 1.0 1.0
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研究主题发展历程
节点文献
电源
上电时序
CPLD
研究起点
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研究分支
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引文网络交叉学科
相关学者/机构
期刊影响力
电子世界
半月刊
1003-0522
11-2086/TN
大16开
北京市
2-892
1979
chi
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36164
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96
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46655
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