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摘要:
介绍了一种自主研发的全集成315 MHz/433 MHz射频发射芯片中编码器的设计.利用分频器产生二选一数据选择器的选通信号,通过逐级筛选,将并行地址数据转变为串行数据.采用Verilog HDL语言进行设计,使用Modelsim进行仿真验证,基于和舰0.18 μm CMOS工艺布局布线.样片测试结果表明,编码器基础时钟频率为250 kHz时可以很好地满足设计指标和功能要求.
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文献信息
篇名 全集成射频发射芯片地址编码器设计
来源期刊 吉首大学学报(自然科学版) 学科 工学
关键词 全集成 射频发射芯片 地址编码器 设计 测试
年,卷(期) 2017,(1) 所属期刊栏目 信息与工程
研究方向 页码范围 24-27
页数 4页 分类号 TN45
字数 2360字 语种 中文
DOI 10.3969/j.cnki.jdxb.2017.01.006
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 唐赞玉 吉首大学信息科学与工程学院 21 49 4.0 6.0
2 胡啸东 1 0 0.0 0.0
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研究主题发展历程
节点文献
全集成
射频发射芯片
地址编码器
设计
测试
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
吉首大学学报(自然科学版)
双月刊
1007-2985
43-1253/N
大16开
湖南省吉首市
1980
chi
出版文献量(篇)
2943
总下载数(次)
1
总被引数(次)
10461
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