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摘要:
提高FPGA芯片的性能和面积效率是FPGA结构研究的目标.结合现有的可拆分查找表和可级联查找表结构的优点,提出了可级联拆分查找表逻辑结构.通过在普通可拆分查找表结构中插入可配置选择器,实现了其中2个子查找表单元的可级联,大大减小了电路中2个子查找表之间的互连延迟.在MCNC测试电路集下,可级联拆分查找表在电路总面积相近的情况下,性能上平均提升12%.
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文献信息
篇名 可级联拆分查找表:增强型逻辑结构
来源期刊 太赫兹科学与电子信息学报 学科 工学
关键词 现场可编程门阵列 级联 可拆分查找表
年,卷(期) 2017,(3) 所属期刊栏目 微电子、微系统与物理电子学
研究方向 页码范围 523-528
页数 6页 分类号 TN492
字数 3339字 语种 中文
DOI 10.11805/TKYDA201703.0523
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 杨海钢 中国科学院电子学研究所 134 485 10.0 15.0
2 江政泓 中国科学院电子学研究所 4 2 1.0 1.0
6 林郁 中国科学院电子学研究所 14 20 3.0 3.0
7 郭珍红 中国科学院电子学研究所 3 1 1.0 1.0
传播情况
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研究主题发展历程
节点文献
现场可编程门阵列
级联
可拆分查找表
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
太赫兹科学与电子信息学报
双月刊
2095-4980
51-1746/TN
大16开
四川绵阳919信箱532分箱
62-241
2003
chi
出版文献量(篇)
3051
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7
总被引数(次)
11167
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