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摘要:
在宽带信号采样的情况下,基带部分需要进行高速数据处理,此时单通道数据处理很难满足时序要求.而并行数据处理会占用大量的FPGA资源,这就需要对并行算法进行优化.在不同的场景下输出数据速率要求不同,这就要求进行数据速率变换.本文讨论了如何对并行FIR滤波器进行优化设计,同时也论述了如何利用多相分解技术进行数据速率变换,结果说明优化后的算法能大幅减少FPGA资源的消耗,并能适应多速率数据变换的应用场景.
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一种高速FIR滤波器的设计及实现
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流水线
专用集成电路
多相并行FIR滤波器的FPGA高速实现方法
FIR滤波器
多相分解
FPGA
高速
内容分析
关键词云
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文献信息
篇名 基于多相分解技术的高速并行FIR滤波器设计
来源期刊 价值工程 学科 工学
关键词 并行FIR滤波器 多相分解 多速率变换
年,卷(期) 2019,(21) 所属期刊栏目 价值应用
研究方向 页码范围 197-200
页数 4页 分类号 TN713
字数 2419字 语种 中文
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1 许自阳 1 0 0.0 0.0
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研究主题发展历程
节点文献
并行FIR滤波器
多相分解
多速率变换
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
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价值工程
旬刊
1006-4311
13-1085/N
大16开
河北省石家庄市槐安西路88号卓达物业楼A501室
18-2
1982
chi
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