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并行性可裁减的实时图像模板匹配VLSI结构
并行性可裁减的实时图像模板匹配VLSI结构
作者:
朱丹
王玉良
原文服务方:
弹箭与制导学报
实时
模板匹配
FBMA
VLSI
FPGA
摘要:
在保证实时性的基础上,对FBMA计算结构进行了改进,提出了一种并行性可裁减的VLSI实现结构.通过对二维脉动阵列进行部分和分解、裁减与重用,以及采用双时钟策略和存储器交互方式,在不降低处理能力的前提下使图像模板匹配的硬件资源利用率进一步提高.文中给出了实时性与处理时钟及PE数量之间关系的数学描述,并在FPGA上对提出的计算结构进行了有效验证.
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文献信息
篇名
并行性可裁减的实时图像模板匹配VLSI结构
来源期刊
弹箭与制导学报
学科
关键词
实时
模板匹配
FBMA
VLSI
FPGA
年,卷(期)
2007,(5)
所属期刊栏目
相关技术
研究方向
页码范围
265-267,270
页数
4页
分类号
TP391.41
字数
语种
中文
DOI
10.3969/j.issn.1673-9728.2007.05.081
五维指标
作者信息
序号
姓名
单位
发文数
被引次数
H指数
G指数
1
朱丹
中国科学院沈阳自动化研究所
40
371
10.0
18.0
2
王玉良
中国科学院沈阳自动化研究所
7
70
4.0
7.0
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版权信息
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研究主题发展历程
节点文献
实时
模板匹配
FBMA
VLSI
FPGA
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
弹箭与制导学报
主办单位:
中国兵工学会
出版周期:
双月刊
ISSN:
1673-9728
CN:
61-1234/TJ
开本:
大16开
出版地:
邮发代号:
创刊时间:
1980-01-01
语种:
chi
出版文献量(篇)
0
总下载数(次)
0
总被引数(次)
28550
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