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摘要:
此次设计介绍了Verilog-HDL语言在可逆计数器的具体应用,给出了仿真波形并下载到FPGA开发板上实际进行验证。说明了实现电子电路的自动化设计(EDA)过程和EDA技术在现代数字系统中的重要地位及作用.
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基于Verilog语言的可预置加减计数器的设计
Verilog HDL
可逆计数器
ModelSim
可预置加减计数器
内容分析
关键词云
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文献信息
篇名 基于Verilog语言的4位二进制可逆计数器的设计
来源期刊 电脑知识与技术:学术版 学科 工学
关键词 VERILOG-HDL EDA FPGA 开发板 仿真
年,卷(期) 2019,(3X) 所属期刊栏目
研究方向 页码范围 219-220
页数 2页 分类号 TP311
字数 语种
DOI
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 葛楠 大连理工大学城市学院 21 25 3.0 3.0
2 杨柳 大连理工大学城市学院 7 15 3.0 3.0
3 李鹏飞 大连理工大学城市学院 16 194 7.0 13.0
4 李百伦 大连理工大学城市学院 2 0 0.0 0.0
5 徐杨 大连理工大学城市学院 3 0 0.0 0.0
6 殷海博 大连理工大学城市学院 2 0 0.0 0.0
传播情况
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引文网络
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2019(0)
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研究主题发展历程
节点文献
VERILOG-HDL
EDA
FPGA
开发板
仿真
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
电脑知识与技术:学术版
旬刊
1009-3044
34-1205/TP
安徽合肥市濉溪路333号
26-188
出版文献量(篇)
41621
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