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摘要:
Fin field-effect transistor(FinFET)technology has been introduced to the mainstream complementary metal-oxide semiconductor(CMOS)manufacturing for low-power and highperformance applications.However,advanced FinFET nodes are facing significant challenges to enhance the device performance due to the increasingly prominent parasitic resistance and capacitance.In this study,for the first time,we demonstrate methods of enhancing p-channel FinFET(pFET)performance on a fully integrated advanced FinFET platform via source/drain(S/D)cavity structure optimization.By modulating the cavity depth and proximity around the optimal reference point,we show that the trade-off between the S/D resistance and short channel effect,as well as the impact on the parasitic capacitance must be considered for the S/D cavity structure optimization.An extra process knob of applying cavity implant on the desired cavity structure was also demonstrated to modify the S/D junction profile for device performance enhancement.
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文献信息
篇名 FinFET Performance Enhancement by Source/Drain Cavity Structure Optimization
来源期刊 微电子制造学报 学科 工学
关键词 FinFET performance parasitic resistance and capacitance source/drain cavity cavity implant
年,卷(期) 2020,(2) 所属期刊栏目
研究方向 页码范围 1-5
页数 5页 分类号 TN3
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研究主题发展历程
节点文献
FinFET
performance
parasitic
resistance
and
capacitance
source/drain
cavity
cavity
implant
研究起点
研究来源
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研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
微电子制造学报
季刊
2578-3769
北京市北土城西路3号中科院微电子研究所
出版文献量(篇)
47
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