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摘要:
RS码是一种纠错能力很强的分组线性码.本文给出了一种GF(64)域上的RS(16,8)码编码器的基本原理和FPGA实现过程,并介绍了有限域常系数乘法的实现.
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有限域
MODELSIM
FPGA
内容分析
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文献信息
篇名 RS编码器的FPGA实现
来源期刊 空间电子技术 学科 工学
关键词 缩短RS码 FPGA 有限域乘法器 编码器
年,卷(期) 2004,(4) 所属期刊栏目 技术报告
研究方向 页码范围 27-30
页数 4页 分类号 TN7
字数 2728字 语种 中文
DOI
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 田斌 西安电子科技大学综合业务网国家重点实验室 74 539 12.0 20.0
2 龙青良 西安电子科技大学综合业务网国家重点实验室 1 6 1.0 1.0
传播情况
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研究主题发展历程
节点文献
缩短RS码
FPGA
有限域乘法器
编码器
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
空间电子技术
双月刊
1674-7135
61-1420/TN
大16开
西安市165信箱
1971
chi
出版文献量(篇)
1737
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9
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6261
论文1v1指导