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摘要:
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DDR内存接口的设计与实现
DDR内存
IP核
地址产生逻辑
FIFO
基于Cyclone系列芯片DDR实现
DDR输入
DDR输出
双向DDR传输
宏函数
除法器
基于新型结构的小面积全数字DDR接口模块
物理层
鉴相器
延迟锁定环
延迟链
面积
版图
内容分析
关键词云
关键词热度
相关文献总数  
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文献信息
篇名 胜创发表Hard-Core系列DDR500内存模块
来源期刊 大众硬件 学科 工学
关键词 Hard-Core系列DDR500内存模块 封装 数据传输率 胜创科技公司
年,卷(期) dzyjc,(2) 所属期刊栏目
研究方向 页码范围 16
页数 1页 分类号 TP333
字数 语种
DOI
五维指标
传播情况
(/次)
(/年)
引文网络
引文网络
二级参考文献  (0)
共引文献  (0)
参考文献  (0)
节点文献
引证文献  (0)
同被引文献  (0)
二级引证文献  (0)
2004(0)
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  • 二级引证文献(0)
研究主题发展历程
节点文献
Hard-Core系列DDR500内存模块
封装
数据传输率
胜创科技公司
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
大众硬件
月刊
1672-0326
11-4927/TP
国标16
北京市海淀区亮甲店130号恩济大厦415
2003
chi
出版文献量(篇)
6780
总下载数(次)
2
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