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摘要:
设计了一种可应用于国家标准AVS(Audio Video Coding Standard)的变字长解码器,根据码流特点进行硬件模块划分;采用桶形移位器并行解码,每个时钟解一个码字,采用Verilog语言进行设计、模拟,通过了FPGA验证.用0.18μmCMOS工艺库综合,电路规模为1.6万门左右,最高频率能够达到166MHz,可实时解码720p/1080i高清AVS码流.
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优化
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视频解码
AVS中可变长解码器的硬件设计
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解码器
可变长码
指数哥伦布码
内容分析
关键词云
关键词热度
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文献信息
篇名 应用于AVS视频解码器的VLD设计
来源期刊 微机发展 学科 工学
关键词 视频解码 变字长解码 AVS
年,卷(期) 2005,(9) 所属期刊栏目 应用开发研究
研究方向 页码范围 122-124
页数 3页 分类号 TN919.81
字数 2005字 语种 中文
DOI 10.3969/j.issn.1673-629X.2005.09.042
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 黄晁 中国科学院计算技术研究所 21 279 10.0 16.0
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研究主题发展历程
节点文献
视频解码
变字长解码
AVS
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
计算机技术与发展
月刊
1673-629X
61-1450/TP
大16开
西安市雁塔路南段99号
52-127
1991
chi
出版文献量(篇)
12927
总下载数(次)
40
总被引数(次)
111596
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