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固定延迟的流水线双精度浮点除法电路
固定延迟的流水线双精度浮点除法电路
原文服务方：
微电子学与计算机
摘要：
除运算采用泰勒级数展开,用5级流水线结构,查找表大小缩小为2.5kB,并获得固定延迟.FPGA综合结果表明,与其他设计电路相比,面积减小了33%.
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期刊影响力
微电子学与计算机
主办单位：
中国航天科技集团公司第九研究院第七七一研究所
出版周期：
月刊
ISSN：
1000-7180
CN：
61-1123/TN
开本：
大16开
出版地：
邮发代号：
创刊时间：
1972-01-01
语种：
chi
出版文献量（篇）
9826
总下载数（次）
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