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基于FPGA的双倍速率动态存储器设计
基于FPGA的双倍速率动态存储器设计
作者:
宋弘
张锋
基本信息来源于合作网站,原文需代理用户跳转至来源网站获取
DDR SDRAM控制器
状态机
FPGA
摘要:
文章介绍了双倍速率动态存储器的系统命令和结构,给出了一种基于状态机的DDR SDRAM控制器的设计,利用状态机对读写操作进行控制以提高系统性能,并实现了FPGA的控制器仿真.
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内容分析
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相关文献总数
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文献信息
篇名
基于FPGA的双倍速率动态存储器设计
来源期刊
四川理工学院学报(自然科学版)
学科
工学
关键词
DDR SDRAM控制器
状态机
FPGA
年,卷(期)
2009,(2)
所属期刊栏目
信息与计算机科学
研究方向
页码范围
65-68
页数
4页
分类号
TP303
字数
1386字
语种
中文
DOI
10.3969/j.issn.1673-1549.2009.02.022
五维指标
作者信息
序号
姓名
单位
发文数
被引次数
H指数
G指数
1
宋弘
四川理工学院自动化与电子信息学院
42
177
7.0
12.0
2
张锋
四川理工学院自动化与电子信息学院
8
29
4.0
5.0
传播情况
被引次数趋势
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引文网络
引文网络
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引证文献(1)
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研究主题发展历程
节点文献
DDR SDRAM控制器
状态机
FPGA
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
四川理工学院学报(自然科学版)
主办单位:
四川理工学院
出版周期:
双月刊
ISSN:
1673-1549
CN:
51-1687/N
开本:
出版地:
四川省自贡市汇兴路学苑街180号
邮发代号:
创刊时间:
语种:
chi
出版文献量(篇)
2774
总下载数(次)
3
总被引数(次)
12372
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