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摘要:
为了克服传统时钟数据恢复方法或过采样技术的缺点,文中给出了兼具结构简单和恢复速度快等优点的自动反馈调节时钟恢复电路。此电路不需要修改原PLL电路结构,只是借用PLL中延时单元电路来得到锁定延时,同时也不需要产生多倍于系统时钟的采样时钟,因而电路设计更加简单,易于实现,而且锁定速度快,面积功耗小。
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文献信息
篇名 自动反馈调节时钟恢复电路设计
来源期刊 电子元器件应用 学科 工学
关键词 PLL 时钟恢复 自动反馈 CDR 高速串行总线
年,卷(期) 2009,(11) 所属期刊栏目
研究方向 页码范围 69-70
页数 2页 分类号 TN713
字数 语种
DOI
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 于忠臣 北京工业大学北京市嵌入式系统重点实验室 38 77 4.0 8.0
2 林平分 北京工业大学北京市嵌入式系统重点实验室 92 254 8.0 12.0
3 万昌盛 北京工业大学北京市嵌入式系统重点实验室 2 0 0.0 0.0
传播情况
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研究主题发展历程
节点文献
PLL
时钟恢复
自动反馈
CDR
高速串行总线
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
电子元器件应用
月刊
1563-4795
大16开
西安市科技路37号海星城市广场B座240
1999
chi
出版文献量(篇)
5842
总下载数(次)
7
总被引数(次)
11366
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